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第七章擦拭
第7章;学习要点;一、 二进制并行加法器;一、 二进制并行加法器;全加器的逻辑图和逻辑符号;实现多位二进制数相加的电路称为加法器。;2、并行进位加法器（超前进位加法器）;加法器的级连;1、8421 BCD码转换为余3码;本节小结;二、 编码器和译码器;（2）优先编码器;集成3位二进制优先编码器74LS148的真值表;IS为使能输入端，低电平有效。OS为使能输出端，通常接至低位芯片的端IS 。OS和IS配合可以实现多级编码器之间的优先级别的控制。QEX为扩展输出端，是控制标志。 QEX ＝0表示是编码输出； QEX ＝1表示不是编码输出。;本节小结;2、译码器;3-8译码器真值表;逻辑表达式;集成二进制译码器74LS138;真值表; 译码器的各个输出都是输入变量的最小项，可以利用全译码器进行组合电路设计。;逻辑电路; 二-十进制译码器的输入是十进制数的4位二进制编码（BCD码），分别用A3、A2、A1、A0表??；输出的是与10个十进制数字相对应的10个信号，用Y9～Y0表示。由于二-十进制译码器有4根输入线，10根输出线，所以又称为4线-10线译码器。;集成8421 BCD码译码器74LS42;真值表（一）;真值表（二）;七段数码显示器内部电路;丙董气彤屋桓鞘验签僵持肯谍甸猜沤世泞歇庆金砾稻喉绪义鞘巴漆渍宣橙第七章的擦拭第七章的擦拭;b=c=f=g=1，a=d=e=0时;2、显示译码器;集成显示译码器74LS48;功能表;辅助端功能;辅助端功能;本节小结;7.1.3 多路选择器和多路分配器;真值表;典型集成数据选择器双4选1 74153;本节小结;2、多路分配器;由地址码决定将输入数据Ｄ送给哪１路输出。;把二进制译码器的使能端作为数据输入端，二进制代码输入端作为地址码输入端，则带使能端的二进制译码器就是数据分配器。;数据分配器的应用;本节小结
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