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PAGE I
目录
TOC \o 1-3 \h \z \u 1 课程设计的目的与作用 1
2 设计任务 1
3 设计过程 1
3.1三位二进制加法计数器（无效态：001,110）的设计 1
3.1.1状态图 1
3.1.2时序图 2
3.1.3选择触发器及时钟脉冲 2
3.1.4求状态方程 2
3.1.5求驱动方程 4
3.1.6画接线图 4
3.1.7检查电路能否自启动 4
3.2序列信号发生器的设计（发生序列100101） 4
3.2.1状态图 4
3.2.2选择触发器及时钟脉冲 5
3.2.3求输出方程 5
3.2.4求状态方程 5
3.2.5求驱动方程 7
3.2.6画接线图 7
3.2.7检查电路能否自启动 7
3.3用74290设计100进制的异步加法计数器并显示 7
3.3.1设计原理 7
3.3.2连线图 8
4 仿真结果分析 9
4.1三位二进制加法计数器（无效态：001,110）的仿真分析 9
4.2序列信号发生器的设计（发生序列100101）的仿真与分析 9
4.3用74290设计100进制的异步加法计数器的仿真与分析 10
6 设计总结 10
7 参考文献 11
PAGE 1
1 课程设计的目的与作用
熟练掌握三位二进制加法器的设计和检测
学习并掌握信号的简单发生以及其电路的设计
加深对教材的理解和思考，并通过实验设计、验证正是理论的正确性。
将所学知识学以致用，加深对知识的理解，培养学习中的创新精神
检测自己的数字电子技术掌握能力，同时进一步提高对multisim的操作技能。
2 设计任务
三位二进制加法计数器（无效态：001，110）
序列信号发生器的设计（发生序列100101）
74290构成100进制异步加法计数器并显示
3 设计过程
3.1三位二进制加法计数器（无效态：001,110）的设计
3.1.1状态图
三位二进制加法计数器逻辑抽象次态为Q2nQ1nQ0n
000 /0 010 /0 011 /0 100 /0 110 /0 111
/1
3.1.2时序图
Q2Q1Q
Q2
Q1
Q0
CP
3.1.3选择触发器及时钟脉冲
本实验选用3个JK触发器。
时钟脉冲：CP=CP0=CP1=CP2
3.1.4求状态方程
总次态卡诺图：
010
010
xxx
100
011
101
111
000
xxx
Q2n的次态卡
0X1011
0
X
1
0
1
1
0
X
Q1n的
1X0101
1
X
0
1
0
1
0
X
Q0n的
0X0111
0
X
0
1
1
1
0
X
3.1.5求驱动方程
由上状态方程得 J0=Q1n
3.1.6画接线图
3.1.7检查电路能否自启动
001 110 不可以自启动
110 001 不可以自启动
3.2序列信号发生器的设计（发生序列100101）
3.2.1状态图
000 /1 001 /0 011 /1 010
/1 /0
111 /0 110
3.2.2选择触发器及时钟脉冲
选择用3个JK触发器。
时钟脉冲：CP=CP0=CP1=CP2
3.2.3求输出方程
1010X
1
0
1
0
X
X
1
0
3.2.4求状态方程
电路次态卡诺图：
001011
001
011
010
110
xxx
xxx
000
111
Q2n的
0001x
0
0
0
1
x
x
0
1
Q1n的
0111x
0
1
1
1
x
x
0
1
Q0n的
1100xx0
1
1
0
0
x
x
0
1
3.2.5求驱动方程
由上状态方程得 J0=Q1nQ
3.2.6画接线图
3.2.7检查电路能否自启动
100 001 可以自启动
101 001 可以自启动
3.3用74290设计100进制的异步加法计数器并显示
3.3.1设计原理
74290为二-五-十进制异步计数器，其中五进制和十进制为8421 BCD码进行计数。
清零功能：当S9=S9A?
置9功能：当S9=S9A?S9B=1时计数器置“9”，即被置成
计数功能：
若把输入计数脉冲CP加在CP0端，即CP0=CP，且把Q0与CP1从外部连接起来，即令CP
如果仅将CP接在CP0端，而CP1与Q0不连接起来，那么计数器的FF0——T‘触发器工作，构成
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