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第 7 章习题解答 7-1 判断题（对的打√，不对的打×） 数字电路分为门电路和时序逻辑电路两大类。 （× ） 边沿触发器和基本 RS触发器相比，解决了空翻的问题。 （× ） 边沿触发器的状态变化发生在 CP 上升沿或下降沿到来时刻，其他时间触发器状态均 不变。（ √ ） 基本 RS 触发器的输入端就是直接置 0 端和直接置 1 端。（ √） 3 位二进制计数器可以构成模为 23 1 的计数器。（× ） 6. 十进制计数器最高位输出的周期是输入 CP脉冲周期的 10 倍。（√ ） 构成一个 7 进制计数器需要 7 个触发器。（× ） 8．当时序电路存在无效循环时该电路不能自启动。 （ √） 寄存器要存放 n 位二进制数码时，需要 2 n 个触发器。（× ） 10．同步计数器的计数速度比异步计数器快。 （ √） 在计数器电路中，同步置零与异步置零的区别在于置零信号有效时，同步置零还需 要等到时钟信号到达时才能将触发器置零，而异步置零不受时钟的控制。 （√ ） 计数器的异步清零端或异步置数端在计数器正常计数时应置为无效状态。（√ ） 自启动功能是任何一个时序电路都具有的。 （× ） 无论是用置零法还是用置数法来构成任意 N 进制计数器时，只要置零或置数控制端是异步的，则在状态循环过程中一定包含一个过渡状态；只要是同步的，则不需要过渡 状态。（ √ ） 用置零法或置位法可以设计任意进制的计数器。 （×） 7-2 由或非门组成的基本 RS触发器如图 7-38 所示，已知 R、S 的电压波形，试画出与之 对应的 Q 和 Q 的波形。 图 7-38 题 7-2 图 解：由或非门组成的基本 RS 触发器的特性表，可得该题的输出端波形如下图所示： 1 或非门 RS 触发器特性表 题 7-2 波形图 7-3 由与非门组成的基本 RS触发器如图 7-39 所示，已知 R、 S 的电压波形，试画出与之 对应的 Q 和 Q 的波形。 图 7-39 题 7-3 图 解：由与非门组成的基本 RS 触发器的特性表，可得该题的输出端波形如下图所示： 与非门 RS 触发器特性表 题 7-3 波形图 7-4 已知如图 7-40 所示的各触发器的初始状态均为 0，试对应画出在时钟信号 CP 的连续 作用下各触发器输出端 Q 的波形。 解： Q1n 1 Q1n Q2n 1 Q2n Q3n 1 Q3n Q4n 1 0 Q5n 1 Q5n Q6n 1 1 Q7n 1 Q7n Q8n 1 Q8n Q9n 1 1 7-5 把 D 触发器分别转化成 JK 和 T 触发器，画出连线图。 解：(1) D 触发器转换为 JK 触发器 : 比较 JK 和 D 触发器的特性方程 Qn 1 JQn K Qn 和 Qn 1 D 可 得 D JQ n KQ n J Q n KQ n , 所以连接图为： 2 (2) D 触发器转换为 T 触发器 : 比较 T 和 D 触发器的特性方程 Qn 1 TQn TQn 和 Qn 1 D 可得 D T Q n TQ n TQ n TQ n , 所以连接图为： 7-6 分别写出图 7-41 所示电路中 C=0 和 C=1 时的状态方程，并说出各自实现的功能。 图 7-41 题 7-6 图 解：当 C=0 时， J=X ， K=X Qn 1 J Qn KQ n X Q n XQn 为T触发器 当 C=1 时， J=X，K= X Qn 1 JQ n K Qn X 为D触发器 7-7 已知 D 触发器是 CP上升沿有效， CP和 D 的输入波形如图 7-42 所示，试画出输出 Q 和 Q 的波形。设触发器的初始状态 Q=0。 图 7-42 题 7-7 图 解：由 D 触发器的特性方程 Q n 1 D ，得到输出端波形如下图所示： 3 7-7 波形图 7-8 TTL 边沿 JK 触发器如图 7-43(a) 所示，输入 CP、J、K 端的波形如图 7-43(b) 所示， 试对应画出输出 Q和 Q 端的波形。设触发器的初始状态 Q=0。 图 7-43 题 7-8 图 解：由 JK 触发器的特性方程 Q n 1 J Qn K Qn ，得到输出端波形图如下图所示： 题 7-8 输出端波形图 7-9 分析如图 7-44 所示电路，画出 Y1、Y2、 Y3 的波形。 7-44 题 7-9 电路图 解： (1) 列驱动方程及状态方程 n J Q K Q Q n 1 Q (2)列输出方程 4 Y1 = Qn Y2 = Qn CP Y3 = Qn CP 画输出波形 . 7-9 波形图 7-10 如图 7-45 所示时序电路。 写出电