数字逻辑设计及应用：chap6 Combinational Logic Design Practices.pptVIP

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2021-02-27 发布于安徽
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数字逻辑设计及应用：chap6 Combinational Logic Design Practices.ppt

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Question How to construct a 3-to-8 decoder by a 74x139? Question Compare the cost of gates of a decimal decoder and a 4-to-16 decoder while decoding 0-9? Full adder Adder Ripple adder tADD = tXYCout + (n-2)*tCinCout + tCinS X Y CI CO S X Y CI CO S X Y CI CO S X Y CI CO S C1 C2 C3 C4 C0 S0 S1 S2 S3 X0 Y0 X1 Y1 X2 Y2 X3 Y3 =0 Speed limited by carry chain Faster adders: eliminate or limit carry chain carry lookahead 1-bit adder：Si = Xi ? Yi ? Ci Ci+1 = Xi·Yi + (Xi+Yi)·Ci Ci+1 = (Xi·Yi) + (Xi+Yi)· Ci = Gi + Pi · Ci Carry generate Carry propagate 0 0 0 0 0 0 0 1 0 1 0 1 0 0 1 0 1 1 1 0 1 0 0 0 1 1 0 1 1 0 1 1 0 1 0 1 1 1 1 1 Ci Xi Yi Si Ci+1 Carry lookahead adder C0 = 0 Ci+1 = Gi + Pi · Ci C0 = 0 C1 = G0+P0·C0 C2 = G1+P1·C1 = G1+P1·(G0+P0·C0) = G1+P1·G0+ P1·P0·C0 C3= G2+P2·C2 = G2+P2·(G1+P1·G0+ P1·P0·C0) = G2+P2·G1+P2·P1·G0+ P2·P1·P0·C0 … … All carries are active after 3 gate delays. 74x2834-bit adder Uses carry lookahead internally Application of 74x283 8-bit adder by cascading 74x283 Ripple carry between groups 74283 C – 1 CO S 3 S 2 S 1 S 0 S 3 S 2 S 1 S 0 A 0 B 0 A 1 B 1 A 2 B 2 A 3 B 3 A3 B3 A2 B2 A1 B1 A0 B0 1 BOUT Example：Realize 4-bit subtractor using 4-bit adder (two’s complement numbers) X – Y = X + Y’ + 1 Application of 74x283 S/A=0: adder S/A=1:subtractor Application of 74x283 Example: Complete two 2-bit unsigned binary numbers multiplier using a 74x283 and some logic gates Multiply X1X0 and Y1Y0 Y0 X0 Y1 X1 Excess-3 code ＝ BCD code ＋ 3 adder A0 A1 A2 A3 B0 B1 B2 B3 C0 S0 S1 S2 S3 C4 74x283 X0 X1 X2 X3 F0 F1 F2 F3 VCC 1 1 0 0 ALU，arithmetic and logic unit Arithmetic and logic operations of 2 n-bit numbers S0~S3 M CIN A0~A3 B0~B3 G P F0~F3 COUT A=B 74x181 Data in Data out 0 arithmetic/1 logic Select operations Function table of 741