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《数字逻辑分析与设计》模拟试题 一、 单项选择题 1. 只有在时钟的下降沿时刻，输入信号才能被接收，该种触发器是（ ）。 A. 高电平触发器 B.下降沿触发器 C. 低电平触发器 D. 上升沿触发器 2. 下列电路中，属于时序逻辑电路的是 ( ) A. 编码器 B. 译码器 C. 数值比较器 D. 计数器 3. 若将一个 TTL 与非门（设输入端为 A 、B ）当作反相器使用，则 A 、B 端应如何连接（ ） A. A 、B 两端并联使用 B. A 或 B 中有一个接低电平 0 C. 不能实现 4. 在二进制译码器中，若输入有 5 位二进制代码，则输出有（ ）个信号。 A. 32 B. 16 C. 8 D. 4 5. 同步 RS 触发器的“同步”时指 ( ) A. RS 两个信号同步 B. Qn+1 与 S 同步 C. Qn+1 与 R 同步 D. Qn+1 与 CP 同步 6. 不是最小项 ABCD 逻辑相邻的最小项是 ( ) A. A BCD B. A B CD C. A B C D D. AB C D 7. 与 A B C 相等的为（ ） A. A B C B. A B C C. A B C 8. 测得某逻辑门输入 A 、B 和输出 F 的波形如图 1 所示，则 F(A ，B) 的表达式是（ ） A. F=AB B. F=A+B C. F A B D. F A B 图 1 1 9. 某逻辑函数的真值表见表 1，则 F 的逻辑表达式是（ ）。 A. F AB AC 表 1 F AB B C A B C F B. 0 0 0 1 0 0 1 1 C. F A B AC 0 1 0 0 0 1 1 0 1 0 0 0 F A B AC 1 0 1 1 D. 1 1 0 0 1 1 1 1 n 1 n 10. 要实现 Q Q ，JK 触发器的 J、 K 取值应为（ ）。 A J=K=0 B J=K=1 C J=0 K=1 11. 可以用来实现并 / 串转换和串 /并转换的器件是 ( ) A. 计数器 B. 全加器 C. 移位寄存器 D. 存储器 12. 下列触发器中没有计数功能的是（ ） A. RS 触发器 B. T 触发器 C. JK 触发器 D. T ˊ触发器 13. 某逻辑电路输入 A 、B 和输出 Y 的波形如图 2 所示，则此电路实现的逻辑功能是（ ） A. 与非 B. 或非