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目 录
实习目的和任务……………………………………….…..….1
软件介绍……………………………………………..……..…2
电路设计……………………………………………..……..…3
原理图与仿真结果……………………………………………6
实习体会………………………………………………………8
参考文献………………………………………………………8
教师评语………………………………………………………9
实习目的和任务
进一步掌握数字电路课程所学的理论知识;
熟悉几种常用集成数字芯片的功能和应用,并掌握其工作原理,进一步学会使用其进行电路设计;
;
培养认真严谨的工作作风和实事求是的工作态度;
完成一项课程设计题目〔选题:彩灯控制器的设计〕
〔1〕设计一个能实现8路彩灯循环显示的彩灯控制器。具有要求如下:
8路彩灯的循环花型如表1所示;
节拍变化的时间为0.5s和0.25s,两种节拍交替运行;
三种花型要求自动循环显示。
节拍顺序
编码输出QA、QB、QC、QD、QE、QF、QG、QH
花型1
花型2
花型3
0
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
0 0 0 0 0 0 0 0
1 0 0 0 0 0 0 0
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1 1 1 0 0 0 0 0
1 1 0 0 0 0 0 0
1 0 0 0 0 0 0 0
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0 0 0 1 1 0 0 0
0 0 1 1 1 1 0 0
0 1 1 1 1 1 1 0
1 1 1 1 1 1 1 1
1 1 1 0 0 1 1 1
1 1 0 0 0 0 1 1
1 0 0 0 0 0 0 1
0 0 0 0 0 0 0 0
1 0 0 0 1 0 0 0
1 1 0 0 1 1 0 0
1 1 1 0 1 1 1 0
1 1 1 1 1 1 1 1
0 1 1 1 0 1 1 1
0 0 1 1 0 0 1 1
0 0 0 1 0 0 0 1
表1
彩灯控制器的组成框图
编码电路驱动电路8路彩灯
编码电路
驱动电路
8路彩灯
分频器控制器
分频器
控制器
图1
〔3〕简要说明
彩灯控制器可由编码电路和控制器组成。
二、软件介绍
Quartus II是Altera公司的综合性PLD/FPGA开发软件,支持原理图、VHDL、VerilogHDL以及AHDL〔Altera?Hardware?Description?Language〕等多种设计输入形式,内嵌自有的综合器以及仿真器,可以完成从设计输入到硬件配置的完整PLD设计流程。
建立工程
〔1〕启动Quartus II
图2
新建工程
图3
图4
图5
三、电路设计
设计所使用的元件:
74LS161〔四位二进制同步计数器〕;
74LS194〔移位存放器〕 ;
74LS151〔八选一数据选择器〕
74LS74〔双D 触发器〕;
74LS00〔四二输入与非门〕;
74LS04〔与非门〕;
发光二极管。
各个单元电路
〔1〕花型演示电路
而花型之间的变化通过花型控制电路的输出即161级联的计数器输出控制〔它们由同一个CP脉冲控制〕。
花型1:从左至右顺次渐亮。全亮后逆序渐灭;
花型2:从中间到两边对称地逐次渐亮,全亮后仍由中间到两边逐次渐灭;
花型3:8路灯分两半。从左至右渐亮,全亮后,再分两半从左至右渐灭;
三种花型变换样式。
每种花型完整显示一遍,所以三种花型完全显示一遍需要的总结拍数为32,即1~16显示第一个花型,17~24显示第二个花型,25~32显示第三个花型。
要用194实现三个花型的连续显示必须对两片194的S1、S0和SL、SR一句节拍的变化进行相应的改变,通过161的输出反应来控制经过观察每16个CP低位片输出Q1—Q4变化比拟频繁,根据变化的花型频率选用高位片的Q5—Q6去控制194的SL、SR、S1、S0的变化从而实现滑行的变化。
图6
由二片161级联的模64〔三种花型节拍每种显示一遍,再总体重复一遍的总节拍数〕计数器。
161的级联用的是同步,并用^QG清零。
图7
〔3〕节拍控制电路
由一片151和一片74级联实现。整体上实现脉冲频率的变换,即交替产生快慢节拍。
图8
原理图与仿真结果
原理图如图8所示
图8
管脚分配如图9所示
图9
图10
电路测试如图11、图12所示
图11
图
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