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常见线路错误 * * 1.针对FLASH/ SDRAM , 如有有不用的data /address pin , 请注意不能floating X V 2. 一些有方向的信号, 连接错误 1). UART/ SPI /I2S/ PCM/AC97针对data 需要注意方向(TXD/RXD. SPIMOSI, SPIMISO) V 2)Audio L/R , Microphone P/N V V 3)Connector (panel connector, power key , function connector) 的方向问题, 需要配合ID 3. 控制信号的状态不确定 V 1)LDO/DC-DC enable 信号不能floating 2) MOS 的控制端 X X V 4. Net 没有连接在一起 Power pin 没有连接 画线路时,相同得net 尽量copy , 不要手key Copy 别人线路时,请注意检查一下power net ,否则,会出现power net 命名不一致,net没有连接起来 GND 命名一致,GPS_GND, GND_GPS, GND_TMC, GND_FM, 这些情况都需要注意 2)co-layout 得料需要注意连接 3) 有些net 漏了连接 X V X X X 4)原本连接在一起的net ,由于部分Net name 更改了,造成net没有连接在一起(注意以下DEG_TXD) V X 5. Net 连接错误 1) 画线路时, 没有注意, 顺序连接错误 2) 不相关得net 连接在一起 X X X 3)没有按照pin define去连接 X V 4) 没有了解原理. 线路net 连接错误(如下是两个DDR, 构成32bit data, 如下线路DQS/ DQM连接错误 X 6 . Net连接没有考虑漏电的问题 (比如 :如下电源最好改成VCC_IN) X X 7 .有多组相同的功能I/O ,要特别注意细微的差别 1) 比如6443 , 有3组4bit SDIO, 如果有INAND 必须选择SD1, 2) 比如UART , Prima CPU TXD0/RXD0 连接BT chip V V 3)SPI通常有低速和高速的区分, 也要特别注意一下 4)GPIO 有些时候是有特殊设定 比如 2450 GPA 只能设置为output, GPM 只能设置为input 比如Prima X_FA[22]~~X_FA[25]内部有pull down 6443 ENIT GPIO 是每两个为一组, 且中断方式必须一致 画线路时, 尽量使用已经验证过的I/O . 新增I/O , 一定要确认清楚spec, 还要和软件确认 5)CPLD 也有注意上面的问题 (比如像如下22 pin) V 8. 电容的位置不理想( CPU PLL power 的电容, 应靠近CPU IC) X 9. 预留相应得component, 便于测试及debug Connector 旁边留 varistor (如下pin3增加) X V 2) clock / reset 信号, 最好预留RC V 3) 对与新功能: 主要预留一些电阻及TP , 便于相关部门测试 10. 线路有些地方不规范 2). 元件与元件之间, 元件与其他net 相连, 最好不要直接连 1). 有多于的节点, trace X V X X 3). Net的标志方向不规范 X V 5)确认不用的pin 做如下处理 V V X 4)Net name 的命名这一般情况下使用大写字母, 且要表示清楚信号的是高有效, 还是low 有效, 如果low 有效, 需要加# X V 7) 本页没有相连的net , 不要多加net X 6) 同一个net , 却有不同net name 8) 为了更好的理解线路, 对有多种选择的地方, 加一下注释 V V 11. 有些元件的value 不正确, 或者该NA没有NA 1) 针对有setting的部分,会选错 *