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一种10位160MS_s采样保持电路的设计
40 6 Vol. 40, No . 6
2010 12 Micr oelectr onics Dec. 2010
10 160 M S/ s
龙善丽, 白 涛, 唐兴刚, 张紫乾
( , 215163)
: 设计了一种用于流水线型A/ D 转换器的 10 位 160 M S/ s CMOS 采样保持器 路采
用 容翻转式结构, 以及运用增益提高技术( gai boosti g) 的折叠式共源共栅放大器, 以满足高
速高精度的要求; 优化采样 容和运算放大器指标, 以保证噪声容限和线性指标; 优化辅助运
放, 从而保证运放的稳定性H SPICE 仿真结果表明, 在 78. 83 M Hz 输入信号160. 34 M Hz 工
作频率下, 输出信号的无杂散动态范围为77. 3 dB
: 采样保持 路; 荷重分配; 折叠式共源共栅放大器
: T N432 : A : 2010)
Desig of a 1. 8 V 10Bit 160 MS/ s CMOS Samplea dHold Circuit
LONG Sha li, BAI Tao, TA NG Xi gga g, ZHANG Ziqia
(East China I nstitute of PhotoE lectronic Integ rated Device, Suz hou, J iangsu 215163, P . R. China)
Abstract: A 10bit 160 MS/ s samplea dhold circuit for pipeli ed A/ D co verter w as desig ed a d fabricated i
1. 8 V 0. 18m CMOS process. I this circuit, fliparou d SHA a d gai boosti g folded cascode OTA w ere used to
achieve high speed a d high resolutio . T he sampli g capacitor a d OT A w ere optimized to obtai sufficie t oise
tolera ce a d li earity . Gai boosti g amplifier w as carefully desig ed t o e sure stability of the OTA . H SPICE sim
ulat io show ed that, for i put sig al of 78. 83 M Hz, the proposed SH A had a SFDR of 77. 3 dB at a sampli g fre
que cy of 160. 34 MH z.
Key words: Samplea dhold circuit; Charge redistribut io ; Folded cascode OT A
EEACC: 2570D
SM IC 0. 18 m CM OS 1P6M
1 引 言 , A / D 1. 8
V 10 160 M S/ s
, A/ D , ,
( ADC) ,
, ADC 2 电路结构
[ 13]
( SHA)
ADC , ADC
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