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中文概述
目錄
MIPI_DSI的研究背景
MIPI_DSI的介紹
概述DSI的4層協議
DSI兩種接口模式
DSI的數據包結構
DSI的數據傳輸
DSI的數據通道分配
DSI的數據傳輸模式
DSI協議層錯誤探測
ECC和CRC
線路爭奪探測與恢復
ACK
MIPI_DSI研究背景
MIPI並不是一個單一的介面或協定,而是包含了一套協議和標準,以滿足各種子系統獨特的要求
MIPI_DSI研究背景
當前手持設備的發展趨勢
顯示屏尺寸變大
分辨率變高
支持各種多媒體高清顯示效果
對數據傳輸的要求
更大的頻率帶寬和更高的傳輸速率
降低功耗
減小EMI噪聲
MIPI_DSI研究背景
DSI的優勢
串行總線,數據傳輸量大
能滿足當前高分辨率、低功耗的要求
更小的EMI、ESD干擾
連接信號線數減低至最少為四根,更小的PCB占位空間
MIPI_DSI研究背景
MIPI_DSI(Display Serial Interface)
符合MIPI協定的串列顯示器介面協定,主機與顯示器之間用差分信號線連接
1對clock信號和1~4對data信號
一般情況下data0可以配置成雙向傳輸
一個主機端可允許同時與多個從屬端進行通信
主要優點
採用差分信號傳輸,減少了EMI影響,可獲得更高的傳送速率(D-PHY:500Mb/s~1Gb/s,M-PHY: 6Gb/s)
採用串行傳輸方式,可以減少主機與顯示器之間的傳輸線
MIPI _DSI的4層協議
MIPI_DSI的4層協議
DSI的4層協議
應用層(Application)
確立或轉換數據的格式,Display命令的編碼與解碼等
底層協議層(Low Level Protocol)
數據包的生成與解析,ECC和CRC的生成和處理等
通道管理層(Lane Management)
數據通道的分配和整合等
物理層(PHY Layer)
給數據包外加開始標誌(SoP)和結束標誌(EoP),數據流程的串行化化與並行化,時鐘管理等
MIPI DSI的4層協議
系統架構圖
DSI兩種接口模式
DSI接口電路支持兩種模式:Video Mode和Command Mode
DSI兩種接口模式
DSI接口電路支持兩種模式:Video Mode和Command Mode
Command Mode Interfaces
發送端最基本信號
Data Lane Module: CIL-MUYY (HS-TX, LP-TX, LP-RX, and LP-CD)
Clock Lane Module: CIL-MCNN (HS-TX, LP-TX)
接收端最基本信號
Data Lane Module: CIL-SUYY (HS-RX, LP-RX, LP-TX, and LP-CD)
Clock Lane Module: CIL-SCNN (HS-RX, LP-RX)
Video Mode Interfaces
發送端最基本信號
Data Lane Module: CIL-MUNN (HS-TX, LP-TX)
Clock Lane Module: CIL-MCNN (HS-TX, LP-TX)
接收端最基本信號
Data Lane Module: CIL-SUNN (HS-RX, LP-RX)
Clock Lane Module: CIL-SCNN (HS-RX, LP-RX)
DSI的數據包結構
DSI數據包格式
長數據包(Long Packet)
短數據包(Short Packet)
長數據包(Long Packet)基本結構
長數據包由3部分組成
PH(Packet Header)
PH又由3部分組成
DI(Data ID):數據標誌位
WC(Word Count):數據包的個數,不包括Checksum
ECC(Error Correction Code):可以糾正一位錯誤,可以檢測兩位錯誤
PD(Packet Data):數據包中的有效數據
PF(Packet Footer):16bit的校驗和CRC。用於傳輸大量圖像數據和命令。
基本結構如下圖所示
DSI的數據包結構
Long Packet基本結構
DSI的數據包結構
Short Packet基本結構
用於傳送命令和寄存器的讀寫,其長度固定為4個字節
DSI的數據傳輸
DSI基本數據傳輸結構
DSI的數據傳輸
數據通道分配由通道管理層定義
通道管理層
依據設計所設定 的N(N最多為4)個數據通道
發送時,將要發送的數據分成N組輸送到相應的數據通道
接收時,將接收到的N組數據組合,恢復到原始的數據序列
DSI的數據通道分配
發送端數據分配
DSI的數據通道分配
接收端數據分配
DSI的數據通道分配
數據通道的選擇
數據通道的控制單元會根據資料包的ID控制資料流程的通道
DSI的數
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