高效可配置浮点fft处理器设计 an efficient architecture design of reconfigurable float-point fft processor.pdfVIP

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2017-08-31 发布于上海
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高效可配置浮点fft处理器设计 an efficient architecture design of reconfigurable float-point fft processor.pdf

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高效可配置浮点fft处理器设计 an efficient architecture design of reconfigurable float-point fft processor

29卷第4期微电子学与计算机 MICROELECTRONICS COMPUTER Vo1．29 No．4 2012年 4月 April2012 高效可配置浮点FFT处理器设计桑红石，高伟 (华中科技大学图像识别与人工智能研究所多谱信息处理技术国家级重点实验室，湖北武汉 430074) 摘要：为了克服高精度浮点FNF处理器具有较大资源开销的设计瓶颈，采用基于单口存储器的FIFO构建共享蝶形结构的R2／2。SDF流水可配置结构．采用适合浮点设计的基 2／2算法实现流水结构，不仅有利于可配置电路的实现，还能够有效减少复数乘法次数，提高复数乘法器的计算效率．采用双倍数据位宽的单口存储器实现FIFO 存储器，有效避免了双口存储器面积和功耗较大的问题．改进的蝶形共享结构实现两级蝶形的合并，解决了单路径延迟反馈流水线结构蝶形单元利用率低的问题．与传统流水线结构FFT处理器设计相比，有效降低了浮点设计中的资源开销，提高了计算单元的利用效率．关键词：快速傅里叶变换；可配置浮点设计；共享蝶形；单路径流水结构中图分类号：TN911．7 文献标识码：A 文章编号：1o0O一7180(2012)04--0036--05 AnEfficientArchitectureDesignofRec0nfigurable Float-pointFFT Processor SANG Hong-shi，GAO Wei (NationalKeyLaboratoryofScienceandTechnologyonMulti-spectralInformationProcessing， InstituteforPatternRecognitionandArtificialIntelligence，HuazhongUniversityofScience andTechnology，Wuhan430074，China) Abstract：Largeresourcecostisthedesignbottleneckofhigh-precisionfloat-pointFI processor，anovelR2／ 2。SDF reconfigurablearchitectureusing shared-butterflywhich employssingle-port-based FIFO．Radix 2／ 2algorithm and pipelinearchitecture，which is suitable forfloat-pointdesign，can reduce themultiplicative complexityandimprovethemultiplicationefficiency．TheFIFOmemoryusingdouble-widthsingle-portraincan avoidthelargerareaandpowercoatofdual-portram．Twobutterflyunitscanbemergedbytheproposedshared- butterflyarchitecture，which solvesthe low utilization factorproblem oftraditionalsingle-path-delay-feedback architecture．Thefloat-pointdesign costisefficientlyreducedand the calculatorutilization factorisimproved， comparedwiththetraditional