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型型奎兰堡土兰竺笙塞
型型奎兰堡土兰竺笙塞 Y昼墨璺Q97
摘 要
本课题来源于“通信原理实验装置”实验箱的开发项目。通信原理实验装置是通信 工程和相关专业的本科生学习“通信原理”课程的实验装置,该装置主要实现锁相环、 循环码的编译码器、帧同步、位同步等实验。本课题的基础是前期已经实现了循环纠 错码的编译码传统电路的设计,本课题的目的是将前期的产品设计升级,将各实验模 块集中到一个可编程逻辑电路(PLD)j占片中,以便于减少芯片的数量和增加可编程、 可升级性。每个实验模块以自顶向下(TOP.DOWN)的设计方法实现硬件描述语言的 设计,然后将各设计集成到一个PLD芯片中。本课题的任务是实现实验装置中循环纠 错码的编译码功能部分的改造。
本文将此任务分为两个阶段的工作,第一阶段是循环纠错码的编译码电路的 VHDL设计和实现。本部分工作拟借助于EDA工具采用硬件描述语言VHDL实现循 环纠错码的编译码。本文从循环纠错码编译码模块的逻辑功能描述出发,用VHDL实 现了所需要的功能,然后用EDA工具对所设计的模块进行编译、综合、仿真。结果 表明所做的设计是完全能够达到设计要求的,而且对于同种类型但不同n、k值的fn,k) 循环纠错码,只要改变模块中相关的语旬,即可实现硬件的重构,因此增大了模块的 可重复使用性,极大地减少了改变设计的工作量。
第二阶段探讨基于可编程片上系统(SOPC)的循环纠错码的编译码器设计过程, 这部分工作为技术的继续升级做储备。随着可编程逻辑器件的发展,已经可以实现将 微处理器软核嵌入到可编程逻辑器件内部。SOPC既具有微控制器系统的高度灵活性, 又具有用户可编程特性,使其成为现代电子技术和电子系统设计的发展方向。本课题 采用Xilinx公司提供的32位微处理器软核MicmBlaze和可编程:芭=片Virtexll和XJJJnx 公司的SOPC开发套件EDK(Embedded Development Kit)作为设计工具。首先用c语 言编写了实现循环纠错码的编译码器硬件的程序,再在MS DOS环境下通过了程序的 编译和调试运行,最后实现了基于Virtexll芯片的循环纠错码的编译码器的SOPC设 计。
关键词:循环纠错码VHDL FPGA SOPC
郑卅I大学顽上学位论立Abstract
郑卅I大学顽上学位论立
Abstract
The subject described in this paper is part work of the development of Communication Theory Experiment Unit.The equipment is a lab tool for students majoring in Communication En【gineering and similar ones while they are learning the course Communication Theory,The usual experiments in the course as phase lock loop,cyclical error_correct coder and decoder,bit syncronization,frame syncronization are equipped with the t001.The equipment has been successfully designed in a traditional way.This paper focuses its upgrading.The product is supposed tO be designed in a way such that all the experiment modules could be integrated in one programmable logic device(PLD).The advantage will be chip number reducing and upgrading ability increasing.The designs fur every experiment modules would be implemented in the TOP-DOWN(from top to down) way.This paper involves the task of rebuilding cyclical error_correct coder and decodert.
Two realizations are described in this paper.Firtly the VHDL based design for real
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