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数字电路与逻辑设计（A卷） 班级 学号 姓名 成绩 一?单项选择题（每题1分，共10分） ?表示任意两位无符号十进制数需要（ ）二进制数。 A. 6 B . 7 C . 8 D . 9 .余3应的2421码为（ ）。 A.BCD.补码1. 1000的真值是（ ）。 A. +1.0111 B. -1.0111 C. -0.1001 D. -0. 1000 .标准或-与式是由（ ）构成的逻辑表达式。 A.与项相或 B. 最小项相或 C. 最大项相与 D.或项相与 5.根据反演规则，F-AV.CPE E的反函数为（ ） A. F=[AC+C（D+E）] E A. F=[AC+C（D+E）] E B. C. F=（aC+CD+E） e d. 下列四种类型的逻辑门中，可以用（ A.与门 B. C.非门 D. 将D触发器改造成T触发器，图1 F 二AC C（D E） E F 二AC C（D E） E ）实现三种基本运算。 或门 与非门 所示电路中的虚线框内应是（ ） 图1 图1 A.或非门 B. 与非门 C. 异或门 D. 同或门 实现两个四位二进制数相乘的组合电路，应有（ ）个输出函数。 A. 8 B. 9 C. 10 D. 11 要使JK触发器在时钟作用下的次态与现态相反，JK端取值应为（）。 A. JK=00 B. JK=01 C. JK=10 D. JK=11 设计一个四位二进制码的奇偶位发生器（假定采用偶检验码），需要（） 个异或门。 A. 2 B. 3 C. 4 D. 5 判断题（判断各题正误，正确的在括号内记“V”，错误的在括号内记“X 并在划线处改正。每题2分，共10分） 原码和补码均可实现将减法运算转化为加法运算。 （ ） 逻辑函数 F（A, B, C）=n M（1,3,4,6, 7）,则F（A, B,C） =》m（0,2,5）。（） TOC \o 1-5 \h \z 化简完全确定状态表时，最大等效类的数目即最简状态表中的状态数目。（ ） 并行加法器采用先行进位（并行进位）的目的是简化电路结构。 （） 图2所示是一个具有两条反馈回路的电平异步时序逻辑电路。 （） 多项选择题（从各题的四个备选答案中选出两个或两个以上正确答案，并将 其代号填写在题后的括号内，每题 2分，共10分） TOC \o 1-5 \h \z .小数“ 0”的反码形式有（ ）。 A. 0. 0……0 ; B . 1. 0……0 ; C. 0. 1……1 ; D . 1. 1……1 .逻辑函数F=A? B和G=AD B满足关系（ ）。 A. F B. F =G C. F =G D. F = G 二 1 3. 若逻辑函数 F（A,B,C） 4m（1,2,3,6）,G（A,B,C）4 m（0,2,3,45,7）,则 F 和 G 相“与”的结果 是（ ）。 4.5. 4. 5. A. m2 m3 B . 1 C 设两输入或非门的输入为x和y，输出为A. x和y同为高电平； B C. x为低电平，y为高电平; 组合逻辑电路的输出与输入的关系可用 A.真值表 B. C?逻辑表达式 D. Ab D . AB ，当z为低电平时，有（ 。 x为高电平，y为低电平； x和y同为低电平. 。描述。 流程表状态图 函数化简题（10分） 1 .用代数法求函数F（A, b,CHab ac bc a b的最简“与-或”表达式。（4 分） 2.用卡诺图化简逻辑函数 F（A ，B，C, D） = E m（2，3，9，11，12）+ 刀d（5，6，7，8， 10，13） 求出最简“与-或”表达式和最简“或-与”表达式。（6分） \AB 电路框图如设计一个将一位十进制数的余3码转换成二进制数的组合电路, 图3所示。（15分） 电路框图如 组合电路 图3 要求： 1 ?填写表1所示真值表； -或表达式;\AB00 01 11 1000 -或表达式; \AB 00 01 11 10 00 01 11 10 表1 ABCD WXYZ ABCD WXYZ 0000 1000 0001 1001 0010 1010 0011 1011 0100 1100 0101 1101 0110 1110 0111 1111 图4 3?画出用PLA实现给定功能的阵列逻辑图 4.若采用PROM实现给定功能,要求PRO啲容量为多大? 六、分析与设计(15分) 某同步时序逻辑电路如图5所示 图5 (1)写出该电路激励函数和输出函数； (2)填写表2所示次态真值表; 表2 输入 X 现态 Q Q 激励函数 J2 K2 Ji Ki 次态 输 出 Z (3)填写表3所示电路状态表; 表3 现态 次态 Q