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数字电子技术综合实验
MAX+PLUS II 快速入门
MAX+PLUS II是Altera公司的全集成化可编程逻辑设计环境。它的界面 友好,在线帮助完备,初学者也可以很快学习掌握。完成咼性能的设计。另外, 在进行原理图输入时,可以直接放置 74系列逻辑芯片,所以对于普通爱好者来 说,即使不使用Altera的可编程器件,也可以把 MAX+PLUS作为逻辑仿真工 具,不用搭建硬件电路,即可对自己的设计进行调试,验证。下面以具体实例 介绍 MAX+PLUS II V10.0 的使用。
MAX+PLUS II 的编译核心支持 Altera 的 FLEX 10K、FLEX 8K、MAX9000、 MAX7000、FLASHlogic、MAX5000、Classic 系列可编程逻辑器件;
MAX+PLUS II的设计输入、处理与校验功能一起提供了全集成化的一套可编程逻
辑开发工具,可加快动态调试,缩短开发周期;
MAX+PLUS II 支持各种 HDL 设计输入,包括 VHDL、Verilog 和 Altera 的 AHDL ;
MAX+PLUS II可与其他工业标准设计输入、 综合与校验工具链接。 与CAE工具的
接口符合 EDIF200和209、参数化模块库(LPM )、Verilog、VHDL 及其它标准。
设计者可使用Altera或标准CAE设计输入工具去建立逻辑设计, 使用MAX+PLUS
II编译器对Altera器件设计进行编译,并使用 Altera或其它CAE校验工具进行器 件或板级仿真。 MAX+PLUS II 支持与 Sy nopsys、Viewlogic、Men tor Graphics、
Cade nee Exemplar、Data I/O、In tergraph、Mi nc、OrCAD 等公司提供的工具接口 ;
使用
使用MAX+PLUS II进行设计包括四个阶段:设计输入、设计处理、设计验证和 器件编程。
乂本綸入建立项且立件 选择黑件设计輛入卷计生成Yes菅胞分配形成下鉉艾件设计实现晅悴下囊
乂本綸入
建立项且立件 选择黑件
设计輛入
卷计生成
Yes
菅胞分配
形成下鉉艾件
设计实现
晅悴下囊
下面以一个最简单的例子,用 ALTERA勺EPL EPFIOkIO实现二分频器,来
示范用MAX+PLUS II进行开发的全过程。
首先启动MAX+PLUS I,进入集成开发环境
运行:maxstart.exe
tl rl MAX+plus. XI Manager - Unti -tlcdl I
HAI+^lus II Eil? AssigTL Qpliens tfelp
□1=1副壘I 吃|血|囤凰剧|0 型 園 ai g|a|a|
设计输入 建立一个新设计输入文件,这里我们采用原理图方式Graphic
Editor file (*.gdf) 来进行设计输入,这是最方便,最直观的逻辑输入方法
i t HMJ+plus II Hz述轩 e t; \cpld\dsfnfl\d*ino1
MAI+plus II File Assi gji Opti ons Help
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选择“OK进入编辑状态
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MAK^pluE II File Edit ew Syntbol A^sign. Utilities Options Window Help
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Un.t i tled.1 二 Gr aph.i c Edi tor
接着输入逻辑元件,在编辑区的空白处双击鼠标。在 Symbol Name栏输入dff,
表示D触发器
■ iM MAX+plus II 一 e: \cpl d\ dem o \ den o 1
HAI+plus n Fi□圄g|劉
HAI+plus n Fi
□圄g|劉
For Help cn this dialog box prass Fl
选择“OK , D触发器就被放在编辑区内。放置器件时,在 Symbol Libraries
框中选择prim库,就可以选择常用的门器件;在Symbol Libraries 框中如选 择mf库,就可以选择常用的74系列逻辑芯片。下面再放一个反相器not:
在反相器上按鼠标右键,将反相器旋转 180度
F面放置I/O脚,输入脚:in put,输出脚:o
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