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四川省电子学会半导体与集成技术专委会2006年度学术年会论文集
NOC功耗分析与建模
杨中明李玉柏
(电子科技大学通信与信息工程学院成都610054)
摘要 随着半导体生产工艺技术的发展，集成电路中传统的基于总线体系结构的SOC设计已经无法满足未来工艺发展的要
On
求，甚至将成为制约系统性能提高的因素。于是NOC(Network
Chip)作为未来纳米级高性能的体系结构被提出来了，
用于解决传统SOC设计中的问题。在NOC设计中，系统的功耗成为了衡量系统性能的重要指标之一。如何降低功耗已经
究，其中重点研究了NOC中功耗的相关闯题，从全局互连链路和路由节点两个方面对NOC的功耗进行分析，建立相应的
模型，并在Matl曲上对所建立的模型进行了仿真，得到仿真结果，最后对仿真结果进行了分析。
关键词 片上网络功耗互连链路路由节点
andModelofNOC’SPower
Analysis Consumption
LiYubai
YangZhongming
Communicationand
(School EngineeringofUESTC，Chengdu
of Information
scales traditionalSOC methodswhichwere
AbstractAsthesemiconductor’S down，the
technology design
couldn’tthefuture in a
basedonbusarchitecturemeet circuits．Then，as
technology’Sdevelopmentintegrated
solve inthe
futurearchitecturewith to the
highperformance，Network-On—Chip(NOC)wasproposed problems
traditionalSOC NOC hasbecomeoneofthe metrics
powerconsumption important
designs．Indesigns，system’S
howto the isall whichis tobe
of reduce
system’Sperformance，and powerconsumptionimportantproblem eager
researchedthe
this
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