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雹 蔫 域 一 种基于FPGA的新型误码仪设计 俞 斌 (湖南工学院 衡阳 421008) 摘 要：本文设计主要分为误码仪硬件电路的设计和FPGA内部功能的软件设计两个部分，硬件设计主要是FP- GA的外围电路设计，RS232电路设计，E PROM电路设计以及按键和指示灯等；软件设计主要是实现了传输速率 在l一24 MHz内8种速率可调、2’一1位、2 一1位、2”一1位3种序列长度的伪随机码码型可选、可手动发送误 码、误码检测以及FPGA片外资源总体控制等误码仪主要功能。 关键词：误码仪；FPGA；LCM 中图分类号：rbt932 文献标识码：A Design of new type bit error tester based on FPGA YU Bin (Hunan Institute ofTechnology， ，lg 昭421008，China) Abstract：There are mainly 2 part designs in this paper，hardware design and software design which based on FPGA．The hardware design is mainly about the circuits around FPGA，RS232 circuits，E PROM circuits，key and led layout designs．Software design are realized some functions like 8 level speed control during 1 to 24 MHz，3 code type to choose 2 一1，2 一1，2 一1，sent error code mann． ally，bit error rate test and some other resources control around FPGA，and so on， Keywords：BERT；FPGA；LCM 采用FPGA来完成误码仪的控制和测试模块一体 0 引 言 化设计，提高了系统功能扩展性和系统的集成度， 使得各个功能模块均可得到详细至逻辑门级的设 误码仪是在通信系统的性能测试以及故障诊 计和改动。 断中必不可少的设备。传统的误码仪基于CPLD 和CPU协同工作，结构复杂，价格昂贵，而且不方 1 误码检测原理 便携带。随着现代EDA设计技术的进步，越来越 多的功能将由硬件设计师集中在单芯片上实现。 误码率是指在测量时间内数字码元误差的数量 本文在分析了误码仪系统需求的基础上，制定出以 与数字码元总数之比。 FPGA为核心的星型结构的误码仪设计方案，提出 在电缆数字网中，除去由于热噪声引起的随机误 嘎螬酗勖菌 ELECTRONIC T EST tlq#t-，所产生的大多数误码可归因于像雷电、交换局脉 (4)基于液晶屏的菜单操作设计； 冲干扰、电源干扰、串话，以及和电力牵引线、电力线平 (5)E PROM控制器； 行产