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高频PCB板制作的技巧 　　摘 要：随着光纤通信、高速以太网等网络及智能化嵌入终端产品的不断推出，信息处理的速度越来越高，这对PCB板材、布局、布线工艺提出了更高的要求。文章主要就高频PCB板布线工艺进行了探讨，以适应信息处理的高速化要求。 　　关键词：高频；布线；工艺；PCB板；高速化 　　中图分类号：TN98 文献标识码：A 文章编号：2095-1302（2016）07-00-02 　　0 引 言 　　PCB（Printed Circuit Board，PCB）板是电子产品的重要电子部件之一，是电子元器件的支撑体，也是电子元器件电气连接的载体。在制作PCB板的过程中，有很多理论上成立的东西，但在工程中却难以实现，尤其在PCB板上存在高频信号和微弱信号的处理时。当PCB板上的信号超过40 MHz时，应该对这些信号线进行特殊的处理。对于更高频率的PCB板，其布线长度、方向和宽度等均有更严格的特殊要求。例如ECL（Emitter Coupled Logic，ECL）等高速数字逻辑门电路，其门传输速度非常高，会在门电路间产生较大的反射信号，在相邻信号线间就会产生相应的串扰，且反射信号会随着门传输速度的提高而增加。此外，由于高速电路的频率较高，功耗和热耗散比较大。因此，在做高速PCB板时需从布局、布线方面重视此问题。本文主要针对高频PCB板的布局、布线、电源等方面，应用具体实例介绍相关的制作技术和方法。 　　1 元器件布局 　　制作PCB板时，首先要考虑元器件间的电性能。考虑布线方便和产品的整体性能，在布局时应该把电气关系紧密的元器件尽量靠近，特别针对一些频率较高的元器件间的布线，这些元器件间的连线比较短。对于大功率器件，应尽量和一些小信号器件分开布局，减小对小信号器件的干扰。满足电性能后再考虑其它方面的布局因素。 　　在高速系统中，首先考虑接地和互连线上的传输延迟时间。系统速度受信号线上的传输时间影响很大。虽然集成电路内部处理速度很快，但由于PCB板上普通互连线上的延迟时间较长，导致系统总延迟时间增加，进而导致系统整体速度下降，这一点在高速移位寄存器、同步计数器等同步器件上尤为明显。因此，如果系统由多块PCB板组成，对于拥有这些特性的高速器件应尽量放在同一个PCB板上，从而避免出现因主PCB板至不同插件板上的时钟信号传输延迟时间不相等而导致移位寄存器等器件产生移位错误的问题。如在高速以太网布局中，以太网芯片DM9000和PH163539的抗干扰电阻电容要尽量贴在芯片周围。 　　此外，有些特殊元器件在布局布线时有特殊的要求，比如模拟电路中的小信号放大器电路，由于处理的是微弱信号，信号易受干扰，如电源噪声、功率器件等，因此要选用稳压效果较好的电源，同时这些器件应尽量远离大功率器件。如果距离增大了还不能满足要求，则要考虑为这些小信号放大器件进行电磁隔离。对于采用ECL（Emitter Coupled Logic，ECL）工艺的芯片而言，如GLINK芯片，其频率高，功耗大，散热要求高，所以在元器件布局时就应考虑散热的问题，如布局在PCB板边缘，利用设备金属外壳或过热孔散热。这些问题在普通PCB板布局时应该注意，在高频PCB板中更要特别重视，可能会导致由于某个器件因布局不合理而致使整个设备无法工作。 　　2 地线、电源的处理 　　如果高频PCB板上的地线、电源布局不合理，可能会产生电磁干扰，导致产品的性能下降，严重情况下可能会导致产品无法正常工作。所以要尽量将电源和地线所产生的噪声干扰降到最低限度，从而保证产品的可靠性。 　　在电源线与地线之间噪声干扰的主要产生原因是地与电源之间的间隙电容，特别在高频中，电路公式为： 　　XC=1/（ωC）=1/（2πfC） （1） 　　式中：XC为电容容抗值；ω为角频率；π为3.14；f为信号频率；C为电容值，单位为法拉。 　　从式（1）中可以看出，地与电源之间的间隙电容越大，其容抗就越小，噪声干扰也就产生了。可采用以下方法降低地与电源之间的噪声： 　　（1）增加线宽，降低噪声； 　　（2）共地处理，降低模数干扰； 　　（3）在电源或地线层上进行信号线布线。 　　2.1 增加线宽，降低噪声 　　加宽电源、地线宽度，能有效的抑制噪声。地线、电源线和信号线线宽的要求是：地线电源线信号线。数字电路中，在PCB板上空余的地方采用大面积覆铜处理。在图1所示的物联网综合实训台底板PCB板中的空余处进行了大面积覆铜处理，形成了一个地线网络，大大增加了地线的有效宽度，但模拟电路的地不能这样处理。在频率较高时，也可以把PCB板做成多层板，电源、地线各占用一层，还可以在电源、地线之间加上去耦合电容，进一步降低地与电源之间的噪声。 　　2.2 共地处理，降低模数干扰 　　许多PCB