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20.2 基本 RS 触发器 ? 20.2.1 电路的构成 ? 20.2.2 两个稳态 ? 20.2.3 触发翻转 ? 20.2.4 真值表 ? 20.2.5 基本 RS 触发器的翻转时间 ? 20.2.6 状态转换图 20.2.1 电路的构成 基本 RS 触发器电路如图 04. 01 所示。 Q Q A B R d S d R d d S Q Q B A ? ? ? ? (a) (b) 图 20.1 基 本 RS 触发器电路图 基本 RS 触发器是由两个与非门，按正反馈方式 闭合而成，也可以用两个或非门按正反馈方式闭合 而成。图（ a ）是习惯画法，图（ b ）是另外一种画 法。基本 RS 触发器也称为闩锁（ Latch ）触发器。 1 0 1 0 Q Q A B R d S d 定义一个与非门的输出端为基本 RS 触发 器的输出端 Q ，图中为 B 门的输出端。另一 个与非门的输出端为 端，因 Q 端和 端为 同一个与非门的输入端和输出端（另一输入 端为高电平），所以这两个端头的状态应该 相反。定义 A 门的另一个输入端为 端，称 为 直接置“ 0 ” 端 ，或 直接复位端 （ Reset ）； B 门的另一个输入端为 端，称为 直接置 “ 1 ” 端 ，或 直接置位端 （ Set ）。 Q Q d R d S 20.2.2 两个稳态 这种电路结构，可以形成 两个稳态，即 1 0 0 1 ? ? ? ? Q Q Q Q 、 ； 、 在没有加入触发信号之前，即和 端都是高电平，电路的状态不会改 变。 当 Q =1 和 =1 决定了 A 门的输出 , 反馈回来，又保证了 Q =1 ； d R 0 ? Q 0 ? Q 1 0 1 0 Q Q A B R d S d “1” “1” 1 0 1 0 当 和 =1 决定了 B 门的输出 Q =0, Q= 0 反馈回来，又保证了 。 1 ? Q 1 ? Q d S 20.2.3 触发翻转 电路要改变状态必须加入触 发信号，因是与非门构成的基本 RS 触发器，所以，触发信号是低 电平有效。若是由或非门构成的 基本 RS 触发器，触发信号是高电 平有效。 设 ，在 端加低电平触发信号， =0 ，于是 Q= 1 ， Q= 1 和 =1 决定了 ，触发器置“ 1” 。但 等 反馈回来， =0 才可以撤消， 是置“ 1” 的触发 器信号。 0 ? Q d S d S d R 0 ? Q 0 ? Q d S d S 设 , 在 端加低电平触发信号 , 于是 , 和 决定了 ，触发器置“ 0” 。 是置“ 0” 的触发器信号。 d R 0 ? Q 1 ? Q 1 d ? S 1 ? Q d R 1 ? Q “1” Q Q A B R d S d O 1 1 1 0 0 “1” Q Q A B R d S d O 1 1 1 0 0 和 是一次信号，只能一个个加，即它们不能同 时为低电平。 d S d R 20.2.4 真值表 基本 RS 触发器用真值表来描述，见表 20.2 。 表中的 Q n 和表示触发器的现在状态，简称 现态； Q n+1 和表示触发器在触发脉冲作用后输出端的新 状态 , 简称 次态 。对于新状态 Q n+1 而言， Q n 也称 为原状态。 d R d S 1 n Q ? 1 n Q ? n Q 0 1 0 1 1 1 0 0 1 1 1 1 0 n Q 1 不定 表 20.2 真值表 动画 4_1 20.2.5 基本 RS 触发器的翻转时间 根据对 RS 触发器工作原理的分析，不难确定触发器翻 转的时间。置“ 0 ” 时，从 加入开始计算到 =1 ，有一个 逻辑门 A 的延迟时间，即 1 t pd 。但此时电路还不能锁存住新 状态，必须再经过逻辑门 B ，延迟 1 t pd 后，等到 Q =0 反馈回来 ，才能撤消 ，锁存住“ 0 ” 状态。所以，完成置“ 0 ” 过程需 要 2 t pd 的时间。同理，置“ 1 ” 也需要 2 t pd 的时间。具体过程见 图 20.3 。据对 RS 触发器工作原理的分析，不难确定触发器 翻转的时间。置“ 0 ” 时， d R Q d R Q A B R d d S Q pd t pd t Q Q d S R d 图 20.3 基本 RS 触发器的翻转时间 20.2.6 基本 RS 触发器的 状态转换图 对触发器这样一种时序数字电路，它的逻辑功能的描 述除了用真值表外，还可以用状态转换图。真值表在组合 数字电路中已经采用过，