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    1Introduction

    ThisuserguidedescribestheDigilentRGB-to-DVI

    IPquickfacts

    EncoderIntellectualProperty.ThisIPinterfacesdirectlyto

    Supporteddevice

    rawtransition-minimizeddifferentialsignaling(TMDS)clockZynq®-7000,7series

    families

    anddatachanneloutputsasdefinedinDVI1.0specsfor

    Sourcedevices.Itencodes24-bitRGBdataalongwithSupporteduserXilinx:vid_io

    interfacesDigilent:TMDS

    thepixelclockandsynchronizationsignals.

    Providedwithcore

    2FeaturesDesignfiVHDL

    SimulationmodelVHDLBehavioral

    •Connectsdirectlytotop-leveldigitalvisual

    ConstraintsfileXDC

    interface(DVI)port

    •24-bit(clockedparalleldatawith

    synchronizationsignals)input

    Testeddesignflows

    •Resolutionssupported:1920x1080/60Hzdownto

    800x600/60Hz(148.5MHz–40MHz)Vivado™Design

    D

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