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2015-08-31 发布于湖北
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2.5Gbps发接器系统接口电路的设计.pdf

系统上程与电子技术尘鎏鉴垒兰垒：!!!! ：：：：=竺璺=：：：§：=塑=竺：：：翌：i：：：：三22： 2．5Gbps发接器系统接口电路的设计覃正才，王涛，洪志良 (复旦大学微电子系集成电路设计实验室，上海200433) 摘要：采用片上阻抗匹配技术和接收端片上可鳊程均衡技术，设计了用于数据率为2．5Gbps发接器系统的接口电路一～发送端的线驱动器和接收端的均衡器电路。基于UMC0．18um标准CMOS工艺模型，用Cadence SpectreS仿真嚣仿真了电路。电路在0℃～125℃范围内，3种工艺角和电源电压变化±10*的条件下能够正确地工作。在1．8V单电源电压下，电路的总功耗为70roW。关键词：线驱动器；码间干扰：均衡器；发接器中图分类号：TN492 文献标识码：A of anInterfaceCircuitina Transceiver Design 2．5Gbps System QIN WANGTao，HONG Zheng—cait Zhi—liang c龇1 (LaboratoryofICDesign-Fudan【厢ⅣP时ity，Shanghai200433t Abstract：Theinterfacecircuitina2 transceiver，whichconsistsofalinedriverin and 5Gbps transmitteran inreceiver，are of and equalizer designedby impedance equalization usingtechnologies matchingprogrammable 0 is BasedonUMC18mCMOS models，thecircuitsimulatedCadence simulators on—chip technological by Spectre’s Inthe 4C，thecircuit、vorks and atif,tt coruersandinthepowerrangeof rangeof0C～125 robustly ssprocess supply 16V“2．0V．For1 8V circuitis70MW． powersupplyvomge，thetotalpowerdissipationofthe Keywords：Linedriver：Inter—symbolinterference；Equalizer：Transceiver 1 引言用片上阻抗匹配技术吲和接收端片上可编程均衡技术，设随着集成电路制造工艺中最小线宽的不断减小．芯片内计了用于数据率高达2．5Gbps发接器系统的低电压低功耗接口电路，并进行了仿真实验