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层次图设计
Cadence软件层次图设计 PCB项目组 2006年9月8日 ※Cadence可以支持平面化设计和层次化设计。 ※平面化设计比较简单，容易查错。 ※层次化设计就是将比较大的复杂的设计分 多个子设计，每个子设计还可再分为多个子设计。 ※在Cadence HDL 中进行层次设计可以支持自顶向下（Top Down）和自底向上（Bottom Up）方法。 模块的基本操作命令： 菜单 Block-- Add—增加Block Rename—重命名Block Stretch—调整Block的大小 Add Pin—增加Block的Pin Rename Pin—重命名Pin Delete Pin—删除Pin Move Pin—移动Pin的位置 自底向上（Bottom Up）方法 ※自底向上的设计就是先创建每个模块的原理图，然后创建或者生成模块，最后在顶层原理图中调用模块。 自底向上的设计步骤： 1.创建底层原理图 2.由原理图生成模块 3.在顶层原理图调用模块 4.模块符号的编辑 自顶向下（Top Down）的设计方法 ※首先创建顶层的原理图，然后添加模块，最后设计每个模块的原理图。 自顶向下的设计步骤： 1.添加模块 2.添加模块的管脚 3.调整模块的大小 4.新建一页原理图 5.编辑原理图 6.另存原理图为相应模块的原理图 层次图网表的生成： 1.未重复调用模块的原理图，网表的生成与平面化设计的原理图相同。 2.重复调用模块的原理图，启动Export Physical对话框，单击Advanced按钮，进入Package Setup对话框，选择Subdesign选项，如图所示： ※ Generate Subdesign:创建子设计 将层次图中重复调用的模块名称加入其中 ※ Force Subdesign:给子设计中的每个元件添加封装信息 将创建的子设计名称加入其中 ※将子设计生成网表 ※将整个原理图生成网表 Thanks！！ 2006-9-08 * top cpu memory power memory1 memory2 memory3 层次图的结构之一： top cpu memory power memory1 memory1 memory1 层次图的结构之二： 2006-9-08 *
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