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最大模式下的控制类引脚 最小模式下8个控制引脚在最大模式下的作用 引脚信号 名称 方向 作用 备注 S2~S0 状态 输出 8086根据3位信号的组合决定总线操作类型和总线控制信号 需要使用外部器件产生总线控制信号 QS1~QS0 指令队列状态 输出 信号组合决定8086内指令队列的状态 便于外部跟踪指令队列动作,表4-4 RT/GT1、 RT/GT0 总线请求/允许 双向 分时输入外部设备的总线使用请求和输出对应的应答信号,均为低有效 相同功能的引脚与最小模式下不同。 RT/GT0优先级高 LOCK 总线封锁 输出 低有效,表示其它部件不能使用总线 LOCK指令 前缀或者中断响应期间有效 8086最大模式下的总线操作类型 由外部总线控制器8288根据3位状态信号决定 例如: MOV AX, [BX+20]的取源操作数阶段,3个引脚的信号? ADD [SI], 20H的保存结果阶段, 3个引脚的信号? 电源和时钟引脚 8086采用单一5V电源 +5V电源接Vcc引脚 GND为接地引脚 8086的标准工作频率为5MHz,实际系统中的工作频率为4.77MHz。时钟信号的占空比为33% 占空比含义 时钟信号从CLK引脚输入 时钟信号由外部专门的器件根据晶振信号生成 4.2 8086的总线操作 相关定义 总线操作:微处理器通过总线所实现的功能,如读存储器、写存储器、读外设、写外设等。 T状态:每一个工作时钟周期对应一个T状态,不同T状态下微处理器完成总线操作的各个子过程。 总线周期:微处理器通过总线完成一次总线操作所需要的时间,包含多个T状态。 总线周期分类 基本总线周期:完成总线操作所需的最小时间单位 扩展总线周期:总线操作需要延长后的时间单位 此外,当总线无操作时所持续的时间称之为总线空闲。 4.2.1 8086总线周期的构成 各类总线周期的组成 基本总线周期由4个T状态构成:T1~T4 扩展总线周期有T1~T3、至少一个Tw(等待状态)和T4构成。至少包含几个T状态? 空闲包含任意多个连续Ti (空闲状态),至少1个 在一段时间内,根据8086所执行程序代码和外部设备的工作情况,总线使用情况不同,如: 空闲-基本-空闲-基本-扩展-基本-空闲-扩展-扩展-空闲 基本总线周期与扩展总线周期 都以T1状态开始、T4状态结束 扩展总线周期中,1~多个连续的Tw位于T3、T4之间 一个总线操作到底需要几个T状态? 原则:①在总线操作的过程中,8086在T3的前沿检测就绪信号READY的状态,执行第二步。②若READY高电平有效直接进入T4,然后总线操作结束;否则进入Tw,并在Tw的前沿继续检测READY,执行第三步。③重复执行第二步,直到某次检测到READY为高电平有效进入T4后总线操作结束。 总结:与8086访问对象的工作速度有关。足够快时通过一个基本总线周期就可以完成一次总线操作,否则需要延长整数倍个Tw。 总线周期中各个T状态的作用 在读、写两类总线操作中,总线周期中所包含的各个T状态的作用不尽形同,但一般可以概括为: T1:输出地址信息并锁存,是总线周期的开始 T2:撤消地址,为传送数据作准备 T3:如果外部准备好,则数据稳定在总线上 Tw:与T3状态相同 T4:读写总线上的数据,总线周期结束 每个T状态的具体作用请分析后面的总线操作时序图。 4.2.2 8086的总线时序 以最小模式为例,讲解总线读操作、总线写操作和复位操作的时序。 关于总线时序图 反映了总线操作的各个子阶段,每个子阶段对应一个T状态。不同的T状态下,通过8086的不同引脚传送信号,控制cpu或外部部件完成对应的子功能。 一个总线周期 T1 T3 T2 T4 CLK A19/S6~A16/S3 BHE/S7 AD15~AD0 ALE M/IO RD DT/R DEN 地址,BHE 状态输出 地址输出 数据输入 低电平读IO,高电平读存储器 1、最小模式下的总线读操作 关于读操作时序的几点说明和思考: 说明: 理解各个T状态的功能。 地址/数据、地址/状态、BHE/S7的复用时间段分别为T1和T2~T4。 地址/数据复用引脚在T2直至检测到外部器件有效前持续为高阻状态。 思考: 如果(DS)=2000H, (SS)=3000H, (BX)=1000H,存储器速度足够块。则8086在指令“MOV AX, [BX+2]”的取源操作数阶段需要几个总线周期,在每个总线周期的各个T状态下不同引脚的信号值或编码组合分别是什么?在取目的操作数时有没有总线操作? 2、最小模式下的总线写操作 一个总线周期 T1 T3 T2 T4 CLK A19/S6~A16/S3 BHE/S7 AD15~AD0 ALE M/IO WR DT/R DE
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