1.2V低功耗时钟发生器设计 Design of A 1.2V Low-Power Clock Generator.pdfVIP

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2017-08-03 发布于上海
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10.3969/j.issn.1003-353x.2011.12.012 DesignofA1.2VLow-PowerClockGenerator XuZhuangYuHuiYueZhangHuiLinXia ShanghaiSiliconIntellectualPropertyExchange,Shanghai200030,China Abstract:Thisphase-locked-loopclockgeneratorisbasedonSMIC65nmCMOSprocess,which focusesonlowpowerandlowjitterdesign.Thegeneratorisdrovedby1.2Vsinglepowersupplyandtheloop filterisintegratedonthechip. Afulldifferentialring-oscillatorconsistedoffivedelaycellsisusedtogenerate 100-800MHzclock,andoutputfrequencyrangeis12.5-800MHz.Thepowerconsumptionis1.54mWat 800MHz.Theperiodjitter(pk-pk)is75psandperiodjitter(rms)is8.6ps;thecycle-to-cyclejitter (pk-pk)is132psandcycle-to-cycle(rms)is14.1ps.Theareaofthecircuitis84μm2. clockgenerator;phase-locked-loop;lowconsumption;lowjitter;ringoscillator. TN431.1 A 1003-353X (2011) 12-0953-04 1.2V低功耗时钟发生器设计徐壮俞慧月张辉林霞上海硅知识产权交易中心，上海200030 摘要：基于整数分频锁相环结构实现的时钟发生器，该时钟发生器采用低功耗、低抖动技术，在 SMIC65nmCMOS工艺上实现。电路使用1.2V单一电源电压，并在片上集成了环路滤波器。其中，振荡器为电流控制、全差分结构的五级环形振荡器。该信号发生器可以产生的时钟频率范围为12.5～800 MHz，工作在800MHz时所需的功耗为1.54mW，输出时钟的周期抖动为：pk-pk=75ps，ms=8.6ps； Cycle-to-Cycle抖动为：pk-pk=132ps，rms=14.1ps。电路的面积为84 μm2。时钟发生器；锁相环；低功耗；低抖动；环形振荡器 TN431.1 A 1003-353X (2011) 12-0953-04 2011年12月 955 @@[1] HAJIM1RIA,LEET H. Design issues in CMOS differentialLC oscillators [J]. IEEE J Solid-State Circuits,1999,34:717-724. @@[2] HAJIMIRIA,LEETH. Ageneraltheoryofphase noiseinelectricaloscillators[J]. IEEEJSolid-State Circuits,1998,33:179-194. @@[3] LEETH. The design of CMOS radio-frequency integrated circuits [M]. Cambridge: Cambridge UniversityPress,2004:566-595. @@[4] HUNGCM,FLOYDBA,PARKN. Afullyintegrated 5